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Methodology Verification of Hierarchically Described VLSI Circuits

Methodology Verification of Hierarchically Described VLSI Circuits

Bain, I.L.; Glasser, L.A.

作者Bain, I.L.; Glasser, L.A.
卷第6卷
期第1期
文件大小725.38KB
发表时间1987
DOI10.1109/tcad.1987.1270253
页码111-115

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